VeriTiger-K115

VeriTiger-K115 是基于单颗Xilinx Kintex UltraScale XCKU115FLVB2104 FPGA 的原型验证系统,是一款低成本、多功能、安全性高的原型验证系统,为用户实现 SOC/ASIC 和 IP 验证等设计提供更加专业、更加便利、更加标准的平台。

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  • 产品特征
  • 系统框图
  • 应用参考
  • FPGA 资源

该系统由单颗Xilinx Kintex UltraScale XCKU115FLVB2104 FPGA芯片为核心,支持1150万逻辑门的设计验证,支持75.9Mb内部随机存储器、支持5520个DSP Slices

  • 存储资源

通过专用的HSPI2-DQS扩展接口,可以为用户提供最多3组DDR3(800MHz)/DDR4(900MHz)的Memory接口

  • 存储资源

通过专用的HSPI2-DQS扩展接口,可以为用户提供最多3组DDR3/DDR4 的Memory接口

  • 时钟资源

VeriTiger-K115 平台 FPGA 提供4路可编程差分时钟,2路固定单端时钟 

2路MMCX 差分时钟输出,1路MMCX差分时钟输入,用于多平台时钟同步 

ZYNQ输出一路单端可编程时钟到FPGA 

  • 用户I/O资源

为用户提供20组HSPI2扩展接口,平台共提供628个select I/O ,通过不同类型的扩展接口支持single ended + LVDS等多种接口标准

通过7个HSPI2-MGT标准连接器为用户提供52组Transceiver 通道

通过2个 HSPI2-LVDS标准连接器为用户提供48路LVDS差分信号

通过QTH-MGT标准连接器支持4组 transceiver 通道和24路单端信号

通过QTH-CLK标准连接器支持8路差分时钟输入和8路差分时钟输出

支持独立的BANK电压配置,支持1.2V;1.35V;1.5V;1.8V;3.3V(仅HRIO Bank)

  • 静态输入资源

2组4位拨码开关

1组自定义LED灯

通过PWD配置4组虚拟I/O

  • 配置模式

支持 原生的JTAG 配置模式,便于用户进行在线调试

支持千兆以太网配置模式,便于用户快速配置环境

支持 SD Card 配置模式,便于用户离线配置环境

  • 软件支持

通过ProtoWizard工具支持Runtime阶段调试,支持多SUIT离线配置,支持多路全局时钟配置

  • 安全措施

支持子卡介入监测,故障报警,VCCIO监测,VCCD监测

支持远程关机,电源监控管理,系统散热管理,异常报警,异常断电自保护

支持电源自测试,支持BANK电压自测试,支持系统状态自测试

支持电压/电流状态回读

支持FPGA镜像加密,支持增高IO保护,支持轨道保护

  • 系统升级

支持在线固件升级,可随时同步最新系统状态

  • 开箱即用

支持开箱即用板卡,提供最小系统快速启动方案,支持双路千兆网卡,支持PCIE接口,支持光纤通讯接口

  • 虚拟按键和数据通路

虚拟按键支持,用户交互更加直观便捷

数据通路功能,为用户提供交互接口,减少用户二次开发工作量

  • FPGA Based Emulator

支持高速仿真,DUT主时钟频率支持50Mhz

支持自动生成软硬件之间的高速互联接口,自动编译软件环境和硬件环境

支持C/C++ Testbench,Verilog/System Verilog/UVM Testbench

支持寄存器100%全可见和硬件断点功能

支持ICE验证(In-Circuit Emulation)

大量通过验证的Transactor,包括 AMBA,GPIO,IIC,GMII等

  • 深度Debug能力

支持8+ Probe通道,通道间支持不同的采样时钟

支持Probe硬件断点

支持Probe 1Kbits*16M深度调试能力,支持每个周期10752bit波形信号

<2M的BRAM占用

最大支持157Mhz的DUIT时钟频率

动态修改Testbench受控时钟频率,不需要重新综合设计工程

获取DUT内部所有Wire/reg类型信号,产生VCD格式波形文件和FSDB格式文件

支持预警提示机制:采样时钟选择错误预警,带宽溢出预警,波形文件可靠性提示

  • 基于ARM的混合验证能力

通过Vivado的tcl脚本,对可操作地址空间进行读写访问

专用的数据通路,对数据进行编解码,提供错误恢复和链路校准,确保链路的稳定可靠

直连串口,方便建立调试通道

AXI总线互联矩阵IP,提供AXI总线互联能力,易于扩展

  • 物理规格

VeriTiger-K115: L216.66mm W223.16mm H115.5mm